非網(wǎng)管以太網(wǎng)交換機IP內(nèi)核（UES）在可配置設(shè)備上實現(xiàn)了即插即用的以太網(wǎng)交換。它不需要外部配置。它旨在使用最少的資源解決最大的吞吐量。

該交換機實現(xiàn)了一個無阻塞交叉開關(guān)矩陣，該矩陣允許所有端口之間進行線速通信。交換機在轉(zhuǎn)發(fā)每個幀之前先對其進行緩存和驗證。然而，等待時間已被最小化到納秒級。此外，UES支持IEEE 1588 V2透明時鐘功能。該功能可糾正引入交換機產(chǎn)生的錯誤的PTP幀，從而使IEEE 1588同步設(shè)備之間的互連保持最高的準確級。

UES是實現(xiàn)基于以太網(wǎng)的工業(yè)網(wǎng)絡(luò)的理想以太網(wǎng)交換機IP。它為以太網(wǎng)PHY設(shè)備提供MII/GMII/RGMII本機接口，并且可以與Xilinx IP結(jié)合使用，以在其他接口中支持RMII或SGMII。它還支持將AXI4-Stream接口連接到其他不具有MAC基接口的IP內(nèi)核。

以下Xilinx FPGA系列可以支持UES：

• 6系列（Spartan，Virtex）
• 7系列（Zynq，Spartan，Artix，Kintex，Virtex）
• Ultrascale（Kintex，Virtex）
• Ultrascale +（Zynq MPSoC，Kintex，Virtex）

通過利用新的Xilinx Vivado工具，可以將UES 輕松集成到您的FPGA設(shè)計中，該工具允許在圖形用戶界面中使用IP內(nèi)核并以簡便的方式配置IP參數(shù)。

非網(wǎng)管以太網(wǎng)交換機IP核的主要功能：

• 即插即用：無需配置
• 高性能：實現(xiàn)端口之間的全交叉矩陣以實現(xiàn)最大吞吐量
• 快速：由于SoC-e專有的MAC地址匹配機制，大大縮短了延遲時間
• 高效：經(jīng)過優(yōu)化，僅需很少的邏輯資源即可在低成本FPGA器件上實現(xiàn)
• 靈活：完全可擴展且可配置，以獲得最佳的功能-尺寸平衡。以下參數(shù)設(shè)計員可用：
  • 端口數(shù)量：可配置的3至16個以太網(wǎng)端口
  • 緩沖區(qū)隊列長度
  • IEEE透明時鐘功能
• 自動：MAC地址學習和老化（默認情況下，存儲容量為2048個MAC地址）。

通過利用新的Xilinx Vivado工具，可以將UES 輕松集成到您的FPGA設(shè)計中，該工具允許在圖形用戶界面中使用IP內(nèi)核并以簡便的方式配置IP參數(shù)。

參考設(shè)計支持的板：

• SoC-e SMARTzynq brick（推薦）
• 對于其他Xilinx/Avnet/SoC-e/板，我們可以提供限時IP內(nèi)核進行評估。

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