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IRIGtimeM: IRIG-B主站IP核

 

 

IRIGtimeM 在FPGA器件上實現兼容IRIG 200-04的時間同步主站。該IRIG-B主站IP旨在支持所有IRIG-B編碼表達式以及DCLS和AM調制,以提供最大的靈活性。

此IRIG-B主站IP每秒生成IRIG-B幀,包括必選和可選的時間信息(秒、分鐘、小時、天、年、控制功能和連續二進制秒數),具體取決于配置上所選擇的IRIG-B時間代碼。該IP被設計為提供自主操作,需要盡可能少的配置。

以下Xilinx FPGA系列支持IRIG timeM

  • 6系列(Spartan,Virtex)
  • 7系列(Zynq,Spartan,Artix,Kintex,Virtex)
  • Ultrascale(Kintex,Virtex)
  • Ultrascale +(Zynq MPSoC,Kintex,Virtex)

 

用于Xilinx Vivado工具的網管以太網交換機IP內核

 

通過利用新的Xilinx Vivado工具,可以輕松地將其集成到你的FPGA設計中,該工具允許在圖形用戶界面中使用IP內核,并以簡便的方式配置IP參數。

IRIGtimeM 主要特點: 
  • 符合IRIG 200-04的時間同步主站
  • 支持DCLS和AM調制
  • 支持所有IRIG-B編碼表達式,包括年份信息、控制功能和直線二進制秒
  • 輸出類型(IRIG-B時間碼)可在實施前和運行中配置
  • 精確的IRIG-B輸出,以提供納秒級精度
  • IP初始設置的32位時間戳輸入
  • 定期脈沖輸出用于測試
IRIGtimeM IP內核框圖如下圖所示:

 

 

參考設計支持的板:

  • SoC-e SMARTzynq brick(推薦)
  • 對于其他Xilinx/Avnet/SoC-e板,我們可以提供限時IP內核進行評估。
欲了解更多信息,請聯系我們:[email protected]

 

 

 


FPGA IP核產品目錄

 

 

 

 


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