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IRIGtimeS: IRIG-B從站IP核 |
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IRIGtimeS 在FPGA器件上實現兼容IRIG 200-04的時間同步從站。該IRIG-B從站IP核已被設計為支持所有IRIG-B編碼表達式以及 DCLS和AM調制，以提供最大的靈活性。
此IRIG-B從站IP核每秒接收IRIG-B幀，并根據IRIG-B時間碼獲取時間信息（秒、分鐘、小時、天、年、控制功能和二進制連續秒）。該IP實現了64位內部計時器，以便提供時間戳（以秒為單位）和納秒值。該定時器的值和頻率與接收到的IRIG-B時間信息同步。該IP被設計為提供自治操作，需要盡可能少的配置。
IRIGtimeS 支持以下賽靈思FPGA系列：
- 6系列（Spartan，Virtex）
- 7系列（Zynq，Spartan，Artix，Kintex，Virtex）
- Ultrascale（Kintex，Virtex）
- Ultrascale +（Zynq MPSoC，Kintex，Virtex）
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用于Xilinx Vivado工具的網管以太網交換機IP內核 |
通過利用新的Xilinx Vivado工具，可以輕松地將其集成到你的FPGA設計中，該工具允許在圖形用戶界面中使用IP內核，并以簡便的方式配置IP參數。
IRIGtimeS 主要特點：
- 符合IRIG 200-04的時間同步從站
- 支持DCLS和AM調制
- 支持所有IRIG-B編碼表達式，包括年份信息，控制功能和直線二進制秒
- 與IRIG-B主站的亞微秒同步
- 在時間和頻率上與IRIG-B主站同步的64位內部定時器
- 32位時間戳（以秒為單位）和32位時間戳（以納秒為單位）
- 定期脈沖輸出用于測試
IRIGtimeS IP核框圖被表示如下圖：
參考設計支持的板：
欲了解更多信息，請聯系我們：[email protected]。 |
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